/* * Autogenerated by the Meson build system. * Do not edit, your changes will be lost. */ #pragma once #define RTE_ARCH x86_64 #undef RTE_ARCH_32 #define RTE_ARCH_64 #define RTE_ARCH_X86 1 #define RTE_ARCH_X86_64 1 #define RTE_BASEBAND_ACC100 1 #define RTE_BASEBAND_FPGA_5GNR_FEC 1 #define RTE_BASEBAND_FPGA_LTE_FEC 1 #define RTE_BASEBAND_NULL 1 #define RTE_BASEBAND_TURBO_SW 1 #define RTE_BUS_DPAA 1 #define RTE_BUS_FSLMC 1 #define RTE_BUS_IFPGA 1 #define RTE_BUS_PCI 1 #define RTE_BUS_VDEV 1 #define RTE_BUS_VMBUS 1 #define RTE_CACHE_LINE_SIZE 64 #define RTE_COMMON_CPT 1 #define RTE_COMMON_DPAAX 1 #define RTE_COMMON_IAVF 1 #define RTE_COMMON_MLX5 1 #define RTE_COMMON_OCTEONTX 1 #define RTE_COMMON_OCTEONTX2 1 #define RTE_COMMON_QAT 1 #define RTE_COMMON_SFC_EFX 1 #define RTE_COMPILE_TIME_CPUFLAGS RTE_CPUFLAG_SSE,RTE_CPUFLAG_SSE2,RTE_CPUFLAG_SSE3,RTE_CPUFLAG_SSSE3,RTE_CPUFLAG_SSE4_1,RTE_CPUFLAG_SSE4_2 #define RTE_COMPRESS_OCTEONTX 1 #define RTE_CRYPTO_BCMFS 1 #define RTE_CRYPTO_CAAM_JR 1 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